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C8051F380/1/2/3/4/5/6/7/C
SFR Definition 20.12. P2: Port 2
Bit
7
6
5
4
3
2
1
0
Name
Type
P2[7:0]
R/W
Reset
1
1
1
1
1
1
1
1
SFR Address = 0xA0; SFR Page = All Pages; Bit Addressable
Bit Name Description Write
Read
7:0
P2[7:0]
Port 2 Data.
Sets the Port latch logic
value or reads the Port pin
logic state in Port cells con-
0: Set output latch to logic
LOW.
1: Set output latch to logic
HIGH.
0: P2.n Port pin is logic
LOW.
1: P2.n Port pin is logic
HIGH.
figured for digital I/O.
SFR Definition 20.13. P2MDIN: Port 2 Input Mode
Bit
7
6
5
4
3
2
1
0
Name
Type
P2MDIN[7:0]
R/W
Reset
1
1
1
1
1
1
1
1
SFR Address = 0xF3; SFR Page = All Pages
Bit Name
Function
7:0
166
P2MDIN[7:0]
Analog Configuration Bits for P2.7–P2.0 (respectively).
Port pins configured for analog mode have their weak pullup, digital driver, and
digital receiver disabled.
0: Corresponding P2.n pin is configured for analog mode.
1: Corresponding P2.n pin is not configured for analog mode.
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